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一粒金砂(中级)

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这样的cic对不对? 根据论坛给的程序改的 [复制链接]

这样的cic对不对? 根据论坛给的程序改的!
//*********************************************************
//cic滤波器 5阶8倍抽取,延迟1, R=8,M=1,N=5
//32+5*log8=47, 所以扩展位sxtx 47位,输出为24位。
//*********************************************************
module cic(clk, x_in, clk2, y_out); //----> Interface

  input        clk;
  input  [31:0] x_in;
  output [23:0] y_out;
  output clk2;
  reg  clk2;

  parameter hold=0, sample=1;
  reg [1:0] state;
  reg [4:0]  count;
  reg  [31:0]  x;      // 输入寄存
  wire [46:0] sxtx;   // 符号扩展输入
  reg  [46:0] i0,i1,i2,i3,i4;
  reg  [46:0] i4d1,   c1, c0;
  reg  [46:0] c1d1,   c2;     
  reg  [46:0] c2d1,   c3;   
  reg  [46:0] c3d1,   c4;     
  reg  [46:0] c4d1,   c5;     
  
  //   抽取器
  always @(posedge clk)
  begin : FSM
    if (count == 7) begin
        count <= 0;
        state <= sample;
        clk2  <= 1;
      end
    else begin
        count <= count + 1;
        state <= hold;
        clk2  <= 0;
      end
  end

  assign sxtx = {{15{x[31]}},x};

//积分器
  always @(posedge clk)
  begin : Int
      x    <= x_in;
      i0   <= i0 + sxtx;        
      i1   <= i1 + i0 ;        
      i2   <= i2 + i1 ;
      i3   <= i3 + i2 ;
      i4   <= i4 + i3 ;          //五级积分      
   end

//梳状器
  always @(posedge clk)
  begin : Comb
    if (state == sample) begin
      c0   <= i4;
      i4d1 <= c0;
      c1   <= c0 - i4d1;
      c1d1 <= c1;
      c2   <= c1  - c1d1;
      c2d1 <= c2;
      c3   <= c2  - c2d1;
          c3d1 <= c3;
      c4   <= c3  - c3d1;
          c4d1 <= c4;
      c5   <= c4  - c4d1; //五级梳状
    end
  end

  assign y_out = c5[46:23];

endmodule

这样的对不对呢?5级8倍抽取...对不对呢?

还有,matlab生成的数据quartus如何读取?
另外仿真生成波形数据如何让matlab读取呢?
求助了
此帖出自FPGA/CPLD论坛
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