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nanaless44

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一粒金砂（初级）
楼主
发表于2008-5-24 10:28 只看该作者
 

FPGA时序报告解释 [复制链接]

本人在ISE综合工具是得到如下时序报告：
Minimum period: 6.761ns (Maximum Frequency: 147.913MHz)
Minimum input arrival time before clock：3.383
Maximum output required time after clock：6.293
Maximum combinational path delay: No path found
请教各位高手这四个变量是如何定义和解释的，他们之间有没有什么联系？

clock, 工具, required, period, before

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cjcnsn
没用过xilinx的 只用过altera的 纯粹帮顶了  详情 回复 发表于 2008-5-27 10:43
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anyjun

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一粒金砂（初级）
沙发
发表于2008-5-24 11:05 只看该作者
 
这个问题适合去
www.edacn.net
www.fpga.com.cn
探讨。
 
 
嵌入式培训  嵌入式系统  嵌入式学习
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cjcnsn

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TA的资源

一粒金砂（初级）
板凳
发表于2008-5-27 10:43 只看该作者
 
没用过xilinx的
只用过altera的
纯粹帮顶了
 
 
 
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