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廖欧亚大陆

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一粒金砂（高级）
楼主
发表于2012-12-10 18:30 只看该作者
 

硬件工程师请看！ [复制链接]

请问各位大侠，尤其是硬件工程师，大家在用FPGA的时候，尤其是xilinx 7系列,大家的封装是从自己画的还是、、、从哪里下载的，官网上似乎没有看见，我们公司现在需要画一个XC7K325T的封装，其引脚将近一千个，自己画真的难以确保完全正确，
封装
此帖出自FPGA/CPLD论坛

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eeleader
应是地线不是完整平面造成，换句话说就得地的不完整性引起的。  详情 回复 发表于 2013-1-15 12:35
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yingang

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一粒金砂（高级）
沙发
发表于2012-12-10 18:49 只看该作者
 
这个看你是什么画图工具，cadence的话有一个小软件，设置好一分钟就搞定。
此帖出自FPGA/CPLD论坛

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廖欧亚大陆
您说的是封装，我表达不清楚，谢谢了，其实关键的真的是原理图库  详情 回复 发表于 2013-1-2 17:41
dontium
一分钟搞定的是个框架，如果要把引脚命名搞完，不仅需要一个一个地对看着填，最后还要校对几遍。 最好的办法是厂商提供的库，如果没有，只有自己慢慢搞了。  详情 回复 发表于 2012-12-11 13:47
 
 
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dontium

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裸片初长成（高级）
板凳
发表于2012-12-11 13:47 只看该作者
 

回复 沙发 yingang 的帖子

一分钟搞定的是个框架，如果要把引脚命名搞完，不仅需要一个一个地对看着填，最后还要校对几遍。

最好的办法是厂商提供的库，如果没有，只有自己慢慢搞了。
此帖出自FPGA/CPLD论坛
 
 
 
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Crazy_HUA

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纯净的硅（中级）
4楼
发表于2012-12-11 14:02 只看该作者
 
只能自己慢慢搞定！
此帖出自FPGA/CPLD论坛
个人签名一个人，一本书，一杯茶，一帘梦。
 
 
 
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408584884

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一粒金砂（高级）
5楼
发表于2012-12-12 00:02 只看该作者
 
封装的话很容易啊，有封装生成的选项，填入管脚数，尺寸等等信息就出来了。麻烦的是原理图库，原理图库的话只能自己一个一个标注
此帖出自FPGA/CPLD论坛
 
 
 
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guoyuboy

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一粒金砂（中级）
6楼
发表于2012-12-12 10:08 只看该作者
 
用Altera吧。Altera有ORCAD封装。
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老阮

199

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纯净的硅（初级）
7楼
发表于2012-12-12 10:08 只看该作者
 
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此帖出自FPGA/CPLD论坛

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廖欧亚大陆
嗯，是我的不对，刚来没有办法加上时间比较急，就、、、看样子大家跟我是一样的感受，PCB封装我也觉得很简单，也是难在原理图库上面，我用的是altium designer 09的。在写谢谢大家了、、只不过官网没有找到  详情 回复 发表于 2013-1-2 17:40
 
 
 
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廖欧亚大陆

83

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一粒金砂（高级）
8楼
 楼主| 发表于2013-1-2 17:40 只看该作者
 

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廖欧亚大陆

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一粒金砂（高级）
9楼
 楼主| 发表于2013-1-2 17:41 只看该作者
 

回复 沙发 yingang 的帖子

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hunansunjianjun

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一粒金砂（中级）
10楼
发表于2013-1-3 00:03 只看该作者
 
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eeleader

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五彩晶圆（高级）
11楼
发表于2013-1-5 20:32 只看该作者
 
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个人签名一个为理想不懈前进的人，一个永不言败人！
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eeleader

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五彩晶圆（高级）
12楼
发表于2013-1-5 20:33 只看该作者
 
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廖欧亚大陆
嗯，也只能这样啦！谢谢了，提供了一种思路！想你讨教一下：地线与电源线之间噪音所产生的原因  详情 回复 发表于 2013-1-13 12:16
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廖欧亚大陆

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一粒金砂（高级）
13楼
 楼主| 发表于2013-1-13 12:16 只看该作者
 

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eeleader

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五彩晶圆（高级）
14楼
发表于2013-1-15 12:35 只看该作者
 
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