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eeleader

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五彩晶圆（高级）
楼主
发表于2012-1-29 14:30 只看该作者
 

数字滤波问题讨论 [复制链接]


有一个A/D模块。一个模拟输入，产生一个16bit的数字输出。需要计算第t（t>=8）个时钟前8个输出的平均值。问需要多少的时序逻辑单元和组合逻辑单元？

face, 问题
此帖出自FPGA/CPLD论坛

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eeleader-mcu
使用RAM的话，需要的逻辑单元应该不多！  详情 回复 发表于 2012-1-29 15:55
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eeleader-mcu

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一粒金砂（高级）
沙发
发表于2012-1-29 15:55 只看该作者
 

使用RAM的话，需要的逻辑单元应该不多！

此帖出自FPGA/CPLD论坛
 
 
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