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一粒金砂（中级）

楼主

发表于2011-9-6 04:45 只看该作者

E题方案分析 [复制链接]

本帖最后由 paulhyde 于 2014-9-15 03:53 编辑

大家E题的方案都是什么啊？测截止频率时的增益都为多少？？

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正想再做。

本帖最后由 paulhyde 于 2014-9-15 03:53 编辑

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dellric

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一粒金砂（中级）

板凳

发表于2011-9-7 21:54 只看该作者

本帖最后由 paulhyde 于 2014-9-15 03:53 编辑

提取同步信号使用m序列的自相关特性，用ADC采集V2的波形后，进行自相关计算，得到相关峰距离，反算同步频率，得到近似同步频率后，使用延迟锁定环或τ抖动环进行精确锁定，实际测量在信噪比为20dB都可以正常同步。这里合理的FPGA+DSP设计是很重要的，当然可以把DSP直接设计到FPGA中，比如用NIOSII+DSP外围实现卷积。

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qianguang1989

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一粒金砂（中级）

4楼

发表于2011-9-10 20:57 只看该作者

本帖最后由 paulhyde 于 2014-9-15 03:53 编辑

我表示有压力！

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