电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › xilinx的pci core怎么例化？我用的是13.1

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纯净的硅（初级）

楼主

发表于2011-8-17 10:49 只看该作者

xilinx的pci core怎么例化？我用的是13.1 [复制链接]

我调用xilinx的pci core，我用的是spatan 3a

xilinx的pci core怎么例化？我用的是13.1，已经生成了ip，想把它例化到原理图中，发现不行。想看一下view HDL Functional Model 也不让我看

查看了一下license，如下图所示

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eeleader

生成PCI CORE的时候，应该生成一个带壳的.VHDL文件，里面应该有元件声明和调用。例如QUARTUS9.0下调用RAM。生成下面的文件 [attach]70040[/attach] 楼主用ISE也应该是一样的啊！详情回复发表于 2011-8-19 13:25

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qd0090

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纯净的硅（初级）

沙发

楼主| 发表于2011-8-19 09:10 只看该作者

继续求助！
论坛里应该有人用过吧？

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eeleader

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五彩晶圆（高级）

板凳

发表于2011-8-19 13:25 只看该作者

生成PCI CORE的时候，应该生成一个带壳的.VHDL文件，里面应该有元件声明和调用。

例如QUARTUS9.0下调用RAM。生成下面的文件

楼主用ISE也应该是一样的啊！

此帖出自FPGA/CPLD论坛

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