电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › 很想知道，用VHDL语言能不能计算误码率？

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一粒金砂（中级）

楼主

发表于2011-5-20 09:20 只看该作者

很想知道，用VHDL语言能不能计算误码率？ [复制链接]

做编译码器的设计呢，要求误码率达到一定要求，但是不清楚能不能用VHDL语言来实现，该怎么实现？

计算, 设计, 误码率, 译码器

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eeleader

这个可以。可以看看书，教科书。详情回复发表于 2011-5-23 09:44

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eeleader

6892 帖子	0 TA的资源

五彩晶圆（高级）

沙发

发表于2011-5-23 09:44 只看该作者

这个可以。可以看看书，教科书。

此帖出自FPGA/CPLD论坛

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