请教synplify和ISE结合使用的问题

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请教synplify和ISE结合使用的问题 [复制链接]

现在再做一个工程 由于工程比较庞大，综合和布局布线的时间非常长 希望能借助synplify 使之能节省比较多的时间用于调试，现在我不需要做仿真 需要把程序下载到FPGA上 然后查看效果 我想请教一下 如何使用synplify和ISE一起使用 能够节省更多的时间 希望请高手们 详细说明 从新建工程 到 下载到FPGA上的全部步骤 

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简单方法：ISE软件对其他公司的软件支持度比较好，如modelsim和synplify pro之类的软件，可以在集成环境中设置综合使用synplify pro，仿真使用modelsim。具体操作是在“edit”菜单->"preference"选项-> "general"选项下"integrated tools"中设置好modelsim和synplify pro的安装路径。注意要想使用modelsim秋synplify pro，在创建工程时还需要设置synthesis tools 为synplify pro，simulator tools为modelsim。在process窗口下会有synplify和modelsim的图标显示。这种方法简单有效，并且对ISE自带的IP core有很好的支持。

分开单独操作：先使用synplify综合，后使用ise进行map等操作。1、用CORE generator生成了一个FIFO和DCM_ADC（按网上说的设置好，如vendow、netlist），然后外加一个module.v对这两个模块进行调用。2、创建一个synplify pro工程，添加这三个.v文件。最后综合生成一个edf文件。3、建立一个ISE工程，工程类型为EDIF，添加第二步生成的EDF文件，进行Implement过程，报了两个error：“NgdBuild:604 - logical block 'u_clk_dcm' with type 'clk_dcm' could not be resolved. A pin name misspelling can cause this, missing edif or ngc file, or the misspelling of a type name. Symbol 'clk_dcm' is not supported in target 'virtex5'。”最终失败，最后在网上查找资料，还是没找到什么有效方法。

今天比较了一下由ISE调用synplify pro生成的edn文件和人工使用synplify pro所生成的edf文件，发现有很大的不同，后者生成的网表没原对ip core进行细化，只当作一个黑盒子，导致ise做impliment时不识别例化的IP module名。如果使用ISE调用synplify pro生成edn文件，将它拷贝出来，新建一个ise工程，并将edn文件加入工程，执行implement操作，则会success，包括translate、map、place&rout。