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一粒金砂(初级)

楼主
 

高手救命!!! [复制链接]

# Loading instances from D:/my_epm_lab/altera_link_modelsim/simulation/modelsim/modelsim_test_v.sdo
# Loading timing data from D:/my_epm_lab/altera_link_modelsim/simulation/modelsim/modelsim_test_v.sdo
# ** Error: (vsim-SDF-3445) Failed to parse SDF file "modelsim_test_v.sdo".
#    Time: 0 ps  Iteration: 0  Region: /vtf_test  File: D:/my_epm_lab/altera_link_modelsim/simulation/modelsim/v

我用的modelsim做时序仿真,可是.sdo文件怎么都反标不进去,一直无法load design。。。sdo文件的region我设的是/testbench/实例化的模块名字
怎么还不对啊。。。求租高手救救我啊,我这个弄一天了。。。下午弄出来了一次结果,晚上再弄又出不来了,快疯啦。。。
我QQ号:175419667 真心求教,要是帖子说不清的话,求高手加下我QQ给我讲下吧。。谢谢了!
此帖出自FPGA/CPLD论坛

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可以把解决的方法给大家分享一下!  详情 回复 发表于 2010-5-8 14:03
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一粒金砂(初级)

沙发
 
呵呵,问题刚刚解决了。。。不用回了哦
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裸片初长成(高级)

板凳
 
不用回了哦
自己可以  删除  掉。。。
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纯净的硅(高级)

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回复 楼主 bitinsomnia 的帖子

可以把解决的方法给大家分享一下!
此帖出自FPGA/CPLD论坛
个人签名快乐是一天,不快乐也是一天,为什么不天天快乐呢
 
 
 

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