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eeleader

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五彩晶圆（高级）
楼主
发表于2010-3-24 08:33 只看该作者
 

FAN-OUT 警告怎样用编程的方法避免？ [复制链接]

如果大家使用Quartus 软件编译VHDL语言或VERILOG语言，使用LEVEL 3 告警层级，将会产生很多FAN-OUT告警，怎样处理。特别是用编程方法，怎样避免？
编程, 软件
此帖出自FPGA/CPLD论坛

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十字星1986
quartus II10.1手册的13-45里面有介绍  也是通过综合指令设置的  详情 回复 发表于 2011-7-21 09:00
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wanggq

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纯净的硅（高级）
沙发
发表于2010-3-25 11:47 只看该作者
 
不是很懂，帮顶
此帖出自FPGA/CPLD论坛
 
 
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hdacwu 该用户已被删除
板凳
发表于2011-7-21 07:46 只看该作者
 
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eeleader

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五彩晶圆（高级）
4楼
 楼主| 发表于2011-7-21 08:21 只看该作者
 
太高级了,大家都没用过呀!
此帖出自FPGA/CPLD论坛
个人签名一个为理想不懈前进的人，一个永不言败人！
http://shop57496282.taobao.com/
欢迎光临网上店铺！
 
 
 
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十字星1986

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一粒金砂（高级）
5楼
发表于2011-7-21 09:00 只看该作者
 
quartus II10.1手册的13-45里面有介绍  也是通过综合指令设置的
此帖出自FPGA/CPLD论坛
 
 
 
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