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潇湘0922

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一粒金砂（中级）
楼主
发表于2016-8-23 17:25 只看该作者
 

请大神帮忙看看，最后输出的结果重复了一个周期 [复制链接]

    最近在做音频方面的项目，要求后一个I2S协议的读时钟是前一个I2S协议的读时钟的两倍，经过仿真在移位寄存器输出的时候，数据重复了两个周期，但是改了好多次，最后的结果还是重复，请大神们指导。
FPGA, Xilinx

audio8_gai.rar

12.26 MB, 下载次数: 2
此帖出自FPGA/CPLD论坛

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楼主，你能画个图说明下你的音频流吗， 最好标记下你的音频时钟。 这样大家容易理解你的需求，以便你得到跟多的输入  详情 回复 发表于 2016-8-24 21:49
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TA的资源

版主
沙发
发表于2016-8-24 21:49 只看该作者
 
楼主，你能画个图说明下你的音频流吗，
最好标记下你的音频时钟。

这样大家容易理解你的需求，以便你得到跟多的输入
此帖出自FPGA/CPLD论坛
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