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学模拟+如何最大限度减少线缆设计中的串扰 [复制链接]

本帖最后由 dontium 于 2015-1-23 11:37 编辑

如何最大限度减少线缆设计中的串扰 deyisupport./blog/b/analogwire/archive/2014/01/22/51614.aspx 解决串扰的最好办法就是屏蔽它,可是参考点怎么选,最后还是会有电容存在的,尽可能减小的话就只有 增大两线的间距,不过这样一来,板子的利用率就会降下来,所以应该权衡利弊。具体在设计中需要综合考虑问题吧,大家有没有资料或者好的设计分享一下!
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