ISE使用DDS核遇到问题，求帮助

乔海权

ISE使用DDS核遇到问题，求帮助 [复制链接]

操作：implement错误

          点击translate后，出现如下错误：

          ERROR:NgdBuild:924 - input pad net 'clk' is driving non-buffer primitives

          出现上述错误的原因：

字面意思是说输入信号clk未经buffer就用来驱动其他primitives了，这个primitives估计指的是我们用做输出的pad。字面意思不难理解，可是怎么修改呢。

在我们的这个例子中，clk有两个load，一个是直接到输出端的test pin，另一个是到内部PLL作为源时钟来产生系统内部时钟。连接PLL时，输入信号先要连接到内部buffer以产生较强的驱动能力，从而保证时钟的时序质量。但是由于输入信号的另一分支不经过任何电路就直接连接到了输出pad，所以存在一种可能，即连接buffer的分支会被短路，从而失去预期的效果。正因为如此，ISE给出了错误警告。

理解这一点以后，解决办法就有了。比如选择CLK经过PLL后无相位差的时钟输出作为test pin，可以达到同样效果，当然会有1个clock的延迟，但是对于时钟信号，这是观察不到的。

另外，如果CLK没有驱动PLL，只有输出到test pin这一个load，那么上述的错误警告就应该不会产生了。

解决办法由，可是具体怎么操作ISE啊？

deweyled

是专用时钟管脚输入给PLL吗？

如果是加一个BUFG的原语应该就可以了。