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一粒金砂（初级）

楼主

发表于2013-1-19 09:08 只看该作者

FPGA与DSP通信研究 [复制链接]

module fpgadsp(

input clk,

input [2:0] addr,

inout [15:0] data,

input CE_2,//FPGA鐗囬

通信

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QQ截图20121214223239.png (12.89 KB, 下载次数: 0)

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eeleader

资料太少了。你研究的成果是？详情回复发表于 2013-1-20 21:11

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eeleader

6892 帖子	0 TA的资源

五彩晶圆（高级）

沙发

发表于2013-1-20 21:11 只看该作者

资料太少了。
你研究的成果是？

此帖出自FPGA/CPLD论坛

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