基于FPGA的飞机信息显示

gaochy1126

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FPGA 采完成报头检测以及时序匹配的工作，首先对输入的数字视频信号同步，锁存控制信号，根据控制输入 MTL 值和当前数字视频信号状态控制 DMTL 值，丢弃门限值以下的信号，然后滤除功率过大的本机干扰信号，滤除脉冲宽度过窄的干扰信号，滤除脉冲宽度过宽无法正确识别 VPP 位置的脉冲。接着产生VPP/ALE/PLE 信号，并根据这些信号的位置关系完成报头初始检测，和计算报头参考功率，然后同步进行三个测试：功率一致性检测，1μs/3.5μs/4.5μs 测试，和 DF 认证。不满足三测试中的任意一个的报头都应丢弃。最后做重触发检测。所有工作完成后填入数据 FIFO，并向 DSP 发送中断请求。从数据输出开始，在一段时间（经测试一般为 13μs）检测功率最大的报头。

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