新手问个弱智的问题

woaizhudi

新手问个弱智的问题 [复制链接]

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文件名：seg.v
描述：程序运行的结果：第0至第七个数码管依次显示0-7；
创建人：何运涛
创建时间：2012年1月17日
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module seg(clk,wela,dula);
input clk;//输入是时钟50M
output[7:0] wela;//数码管位选
output[7:0] dula;//数码管段选
reg[2:0] i;
reg[7:0] wela;
reg[7:0] dula;
reg[7:0] we [7:0];
reg[7:0] du [7:0];
reg[15:0] counter;
initial
begin
 we[0]<=8'b0111_1111;//第7个数码管位选
 we[1]<=8'b1011_1111;//第6个数码管位选
 we[2]<=8'b1101_1111;//第5个数码管位选
 we[3]<=8'b1110_1111;//第4个数码管位选
 we[4]<=8'b1111_0111;//第3个数码管位选
 we[5]<=8'b1111_1011;//第2个数码管位选
 we[6]<=8'b1111_1101;//第1个数码管位选
 we[7]<=8'b1111_1110;//第0个数码管位选
 du[0]<=8'h03;//0的编码
 du[1]<=8'h9f;//1的编码
 du[2]<=8'h25;//2的编码
 du[3]<=8'h0d;//3的编码
 du[4]<=8'h99;//4的编码
 du[5]<=8'h49;//5的编码
 du[6]<=8'h41;//6的编码
 du[7]<=8'h1f;//7的编码
end
always@(posedge clk)
begin
 counter=counter+1'b1;
 if(counter==16'd50_000)//判断是否到1ms
 begin
  wela=we;//依次点亮七个数码管
  dula=du;
  counter=0;
  i=i+1'b1;
 end
end
endmodule

 

 

这个代码我编译能通过（在quartus11.0上编译的），下到实验板上现象和我预想的一样

不是说initial语句是不可综合的吗？为什么这个程序能在开发板上运行呢？

 

eeleader

initial语句可能是被综合掉，但不影响你的编译结果而已罢了

marco515

请问这段程序能正常运行吗？

 

woaizhudi

能啊，在开发板上运行的结果和我预想的一样

wu924360

可能是被综合掉了

金鱼588

请问这段程序能正常运行吗？