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一粒金砂(中级)

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示波器等效采样的核心代码Verilog [复制链接]

本帖最后由 paulhyde 于 2014-9-15 03:09 编辑

本附近包含了工程文件,仿真文件等。主要是在做示波器中等效采样的核心就是产生精确的步进延迟。

 

 

jdclk.rar

275.77 KB, 下载次数: 182

售价: 1 分芯积分  [记录]

产生步进延迟电路verilog

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学习一下  详情 回复 发表于 2017-7-29 11:39
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一粒金砂(高级)

沙发
 
本帖最后由 paulhyde 于 2014-9-15 03:09 编辑

沙发!thanks

 

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基于什么的是C的还是FPGA?

本帖最后由 paulhyde 于 2014-9-15 03:09 编辑

请说明一下

 

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个人签名http://shop34182318.taobao.com/
https://shop436095304.taobao.com/?spm=a230r.7195193.1997079397.37.69fe60dfT705yr
 
 
 

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一粒金砂(中级)

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本帖最后由 paulhyde 于 2014-9-15 03:09 编辑

VErilog的

 

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一粒金砂(初级)

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本帖最后由 paulhyde 于 2014-9-15 03:09 编辑

好像不错哦,看看

 

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一粒金砂(中级)

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感谢楼主了
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一粒金砂(初级)

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感谢楼主了
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纯净的硅(初级)

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又是收费的,又要果断不下。
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一粒金砂(初级)

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look  一下
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一粒金砂(初级)

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要不要都是收费的呀、。。。没钱
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一粒金砂(初级)

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很好
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一粒金砂(中级)

12
 
楼主你有基于microblaze的示波器设计代码吗?我怎么找都找不到,
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一粒金砂(初级)

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