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用PLL产生反向时钟有问题
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发表于2010-12-30 13:03
只看该作者
用PLL产生反向时钟有问题
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在
Altera
的
FPGA
里用了一个PLL,希望产生一个相位差为180度的时钟,就是和原来的时钟反向,但发现出来的时钟
和原时钟相位不是我期望的180度。那位知道该怎么办呢 ?
时钟
,
希望
,
相位差
此帖出自
FPGA/CPLD论坛
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