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TA的资源

一粒金砂(高级)

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module compare(a,b,dout);
     input a;
     input b;
     output dout;
     //wire dout;
     assign dout=(a==b)?1:0;
endmodule

综合后有一个warning:signed to unsigned assignment occurs.是针对那条assign赋值语句的
请问这个warning对最后会有影响吗?
这里似乎涉及到无符号和有符号的问题
此帖出自FPGA/CPLD论坛

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警告:不影响运行结果! 上面警告意思:assignment 处 发生有符号到无符号处转变!   修改程序如下: module compare (a,b,dout) input a; input b; output dout; assign dout=(a==b)?1'b1:1'b0;      详情 回复 发表于 2010-11-4 15:12
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五彩晶圆(高级)

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警告:不影响运行结果!

上面警告意思:assignment 处 发生有符号到无符号处转变!

 

修改程序如下:

module compare (a,b,dout)

input a;

input b;

output dout;

assign dout=(a==b)?1'b1:1'b0;

 

 

此帖出自FPGA/CPLD论坛
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