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发表于2010-9-13 11:13 只看该作者

Verilog RTL级与行为级描述区别 [复制链接]

行为级描述目的是加快仿真速度，做法是尽量减少一个always块中要执行的语句数量，其结果不是为了综合
RTL级描述是为了综合工具能够正确的识别而编写的代码，verilog中有一个可综合的子集，不同的综合工具支持的也有所不同

同样的问题。。支持一下详情回复发表于 2010-9-13 11:21

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发表于2010-9-13 11:21 只看该作者

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Verilog RTL级与行为级区别小结，欢迎点评！
目的区别：行为级描述目的是加快仿真速度，做法是尽量减少一个always块中要执行的语句数量，其结果不是为了综合，只关注算法。有行为综合工具，可以直接将行为级的描述综合为RTL级的，比如BehavioralCompiler。形式区别：RTL级描述是为了综合工具能够正确的识 ...
跟夏老师学FPGA（12）verilog中行为级和RTL级
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