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电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › 夏宇闻老师书第17章RISC_CPU 操作和时序仿真的问题

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纯净的硅（高级）

楼主

发表于2024-6-21 09:22 只看该作者

夏宇闻老师书第17章RISC_CPU 操作和时序仿真的问题 [复制链接]

新建工程，编译通过

运行仿真

这是什么原因呢？请指教，谢谢！

此帖出自FPGA/CPLD论坛

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