【新思科技IP资源】RDC成功签核共需要几步？

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在上周关于跨时钟域（CDC）的文章中，我们指出CDC错误对于ASIC设计是最大的挑战之一。

 

跨复位域（RDC）错误同样可能会造成灾难性后果，在芯片验证的过程中，同时对CDC和RDC进行可靠的签核十分重要！

 

在芯片上，即使在单个时钟域内，源端触发器的异步复位端复位导致其输出跳变，该跳变传播到目的端触发器的数据输入端，就有可能会产生RDC，而RDC很容易导致亚稳态问题（如下图）。

 

 

RDC错误发生的频率比CDC错误要低很多，所以想要在流片前识别出RDC错误，找到错误根本原因并进行调试非常困难，因此，在流片前对RDC进行分析是保证签核成功的关键操作。

 

为确保RDC成功签核，开发者应该将RDC验证策略嵌入到完整的ASIC开发工作流程中，并在RTL开发的早期阶段就执行RDC分析，从而在芯片流片前能够顺利签核RDC。

 

那么，开发者们都有哪些需要注意的RDC挑战呢？

 

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