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eeleader

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五彩晶圆（高级）
楼主
发表于2010-4-20 13:44 只看该作者
 

怎样提高FPGA调试的方便性？ [复制链接]

各位达人，有啥高招？
个人理解，预留调试端口，观察内部状态变量。
高招
此帖出自FPGA/CPLD论坛

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小志
看来基本都知道，需要每步的功夫啊，比如编码、仿真、调试……  详情 回复 发表于 2010-4-21 10:51
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小志

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五彩晶圆（高级）
沙发
发表于2010-4-20 17:06 只看该作者
 
逻辑分析仪
此帖出自FPGA/CPLD论坛
 
 
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mr.king

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一粒金砂（高级）
板凳
发表于2010-4-20 18:37 只看该作者
 

没有数字存储示波器

开发FPGA时序很难
此帖出自FPGA/CPLD论坛
 
 
 
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sanworld

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一粒金砂（初级）
4楼
发表于2010-4-20 19:32 只看该作者
 
我原来做过一些小实验。。。一般是软件上仿真看波形吧。。。硬件的话。。是用signallab 2仿真的。。
此帖出自FPGA/CPLD论坛
 
 
 
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HDLWorld

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纯净的硅（高级）
5楼
发表于2010-4-21 10:43 只看该作者
 

功能仿真做充分就好了

我曾经和中科院计算所的人在FPGA板上给龙芯2做原型验证，功能仿真做的很充分，上板后有些小问题，用内嵌逻辑分析仪把信号抓出来看看，就基本搞定了。 大部分的问题都要在RTL级解决。为了保证逻辑综合和布局布线的功能和RTL仿真一致，需要确保代码的可综合性。 可以在网上找下 RMM设计规则看下。
此帖出自FPGA/CPLD论坛
 
 
 
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小志

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五彩晶圆（高级）
6楼
发表于2010-4-21 10:51 只看该作者
 
看来基本都知道，需要每步的功夫啊，比如编码、仿真、调试……
此帖出自FPGA/CPLD论坛
 
 
 
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eeleader

6892

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五彩晶圆（高级）
7楼
 楼主| 发表于2010-4-21 11:37 只看该作者
 
最好的办法就是深厚积累，对应用的理解，熟练的语法！
此帖出自FPGA/CPLD论坛
个人签名一个为理想不懈前进的人，一个永不言败人！
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