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调查: 设计FPGA, 使用VHDL 多还是使用verilog多?

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五彩晶圆(高级)

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发表于 2011-2-12 11:18:39 | 显示全部楼层 |阅读模式
调查: 设计FPGA, 使用VHDL 多还是使用verilog多?
此帖出自FPGA/CPLD论坛
一个为理想不懈前进的人,一个永不言败人!
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裸片初长成(初级)

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发表于 2011-2-12 11:27:00 | 显示全部楼层
呵呵。。。我们读书的时候学的是VHDL语言!

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五彩晶圆(初级)

Rank: 7Rank: 7Rank: 7

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发表于 2011-2-12 12:02:16 | 显示全部楼层
学校教的是VHDL 但是我个人偏向于Verilog
QQ:1625345502

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五彩晶圆(高级)

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 楼主| 发表于 2011-2-12 16:12:53 | 显示全部楼层

我个人在日常工作使用VHDL 居多!

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一粒金砂(高级)

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发表于 2011-2-12 22:11:12 | 显示全部楼层

只会VHDL

自学的

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一粒金砂(初级)

Rank: 1

发表于 2011-2-21 14:52:08 | 显示全部楼层
verilog,这个比较简单,所以就它了。。。。

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五彩晶圆(中级)

Rank: 8Rank: 8

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发表于 2011-2-21 16:02:31 | 显示全部楼层

回复 楼主 eeleader 的帖子

我觉得verilog比较容易上手哈哈哈

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一粒金砂(初级)

Rank: 1

发表于 2011-2-22 09:45:13 | 显示全部楼层
我们这边基本都是verilog的,夏老师的书上不是说:从发展趋势看verilog比VHDL有更宽广的前途

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一粒金砂(高级)

Rank: 3Rank: 3

发表于 2011-2-22 18:16:34 | 显示全部楼层
各有各的优势吧~有C的经验就学verilog

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一粒金砂(中级)

Rank: 2

发表于 2011-3-20 21:54:59 | 显示全部楼层

回复 楼主 eeleader 的帖子

这是个很纠结的问题, 本科学的VHDL,用的Altera的Quartus软件和FPGA

研究生时老师教的Verilog,用的Xilinx的软件和FPGA,本来VHDL学的就很一般,现在学Verilog学的都不想再看VHDL了

enjoying EDA

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五彩晶圆(高级)

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 楼主| 发表于 2011-3-23 11:48:49 | 显示全部楼层

我是一直在用VHDL, 对VERILOG 也不排斥,  有时两者混合调用!

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