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FROM....TO....约束关于from to 的约束是一个比较实用,也比较好用的约束。 尤其在跨时钟域处理中的应用,特别有效。
举例: 设计中有两个时钟,一个是PLL的输入,一个是PLL的输出,当设计中有数据在该两个时钟域中传递时,
又没有用到fifo隔离,那么这个使用就需要用这个约束。
TIMEGRP "tg_from" = RISING "PLL_IN" ;
TIMEGRP "tg_to" = RISING "PLL_OUT" ;
TIMESPEC "TS_CLK" = FROM "PLL_IN" TO "PLL_OUT" TIG;
TIMESPEC "TS_CLK" = FROM "PLL_OUT" TO "PLL_IN" TIG;
这样工具就不会对该两个跨时钟路径就不会分析了。
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