电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › 有谁知道怎样在quartusii13.1中对cpld进行时序分析

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一粒金砂（中级）

楼主

发表于2018-8-12 23:09 只看该作者

有谁知道怎样在quartusii13.1中对cpld进行时序分析 [复制链接]

本帖最后由 sunboy25 于 2018-8-12 23:11 编辑

我想问一下有谁知道怎样在quartusii13.1中对cpld进行时序分析(Timequest Timing Analyzer)？有实例最好.

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sunboy25

那它(CPLD)怎样分析时序? 详情回复发表于 2018-8-18 15:11

FPGA培训 FPGA设计 verilog教程

sunboy25

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一粒金砂（中级）

板凳

楼主| 发表于2018-8-18 15:11 只看该作者

coyoo 发表于 2018-8-17 09:12
CPLD不能用TQ进行时序分析

那它(CPLD)怎样分析时序?

此帖出自FPGA/CPLD论坛

coyoo

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一粒金砂（高级）

4楼

发表于2018-8-20 13:31 只看该作者

新的MAX10是可以的，老的片子就不要分析什么时序了

此帖出自FPGA/CPLD论坛

sunboy25

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一粒金砂（中级）

5楼

楼主| 发表于2018-8-23 10:29 只看该作者

好的，谢谢1

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