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全部都是泡馍

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一粒金砂（中级）
发表于2017-9-20 15:50 显示全部楼层

关于FPGA中的LVDS引脚接口 [复制链接]

请问各位大佬，FPGA中的管脚是都可以设置为LVDS接口，还是只有部分管脚可以？

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Simon_Simon
LVDS都是一对一对的，看看管脚分配图   详情 回复 发表于 2017-10-12 09:48

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chenzhufly

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发表于2017-9-20 16:42 显示全部楼层
部分 具体看管脚分布

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全部都是泡馍
怎么看呢？如何才能确定具体哪些管脚可以设置为LDVS  详情 回复 发表于 2017-9-20 16:48
个人签名生活就是油盐酱醋再加一点糖，快活就是一天到晚乐呵呵的忙
===================================
做一个简单的人，踏实而务实，不沉溺幻想，不庸人自扰
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全部都是泡馍

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一粒金砂（中级）
 楼主| 发表于2017-9-20 16:48 显示全部楼层
chenzhufly 发表于 2017-9-20 16:42
部分 具体看管脚分布

怎么看呢？如何才能确定具体哪些管脚可以设置为LDVS
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orta

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一粒金砂（中级）
发表于2017-9-21 00:35 显示全部楼层
planahead

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全部都是泡馍
啥意思  详情 回复 发表于 2017-9-21 13:24

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全部都是泡馍

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一粒金砂（中级）
 楼主| 发表于2017-9-21 13:24 显示全部楼层
orta 发表于 2017-9-21 00:35
planahead

啥意思
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一粒金砂（初级）
发表于2017-9-21 16:22 显示全部楼层
altera 差分时钟输入，直接_p接入,设置为lvds 与 调用mega核中的buf来实现是否有差别?
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joywyc

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一粒金砂（中级）
发表于2017-10-4 20:29 显示全部楼层
详见相关芯片的Datasheet都有的........

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dongsy2012

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一粒金砂（中级）
发表于2017-10-11 19:18 显示全部楼层
芯片资料里面有管脚分配，哪些是差分信号引脚，都很清楚

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全部都是泡馍
好的，谢谢啊  详情 回复 发表于 2017-10-12 09:08

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全部都是泡馍

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一粒金砂（中级）
 楼主| 发表于2017-10-12 09:08 显示全部楼层
dongsy2012 发表于 2017-10-11 19:18
芯片资料里面有管脚分配，哪些是差分信号引脚，都很清楚

好的，谢谢啊
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Simon_Simon

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一粒金砂（初级）
发表于2017-10-12 09:48 显示全部楼层
LVDS都是一对一对的，看看管脚分配图
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