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小二红

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一粒金砂（中级）
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发表于2015-12-20 13:33 只看该作者
 

RTL图显示5‘NC [复制链接]

ad_out[14..0]和data_in[14..0]在RTL图上出现5‘NC是什么原因？求大神详解
Altera

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图中5’NC是什么原因出现的？

图中5’NC是什么原因出现的？
此帖出自FPGA/CPLD论坛

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zouxiaohong521
这个确实奇怪，光凭借这个图看不出什么。  详情 回复 发表于 2015-12-21 09:22
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白丁

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版主
沙发
发表于2015-12-20 22:13 只看该作者
 
建议楼主贴出代码来看看
此帖出自FPGA/CPLD论坛

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小二红
找到原因了 是因为顶层代码位数定义错了  详情 回复 发表于 2015-12-22 16:59
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zouxiaohong521

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一粒金砂（初级）
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发表于2015-12-21 09:22 只看该作者
 
这个确实奇怪，光凭借这个图看不出什么。
此帖出自FPGA/CPLD论坛
 
 
 
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小二红

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一粒金砂（中级）
4楼
 楼主| 发表于2015-12-22 16:59 只看该作者
 
白丁 发表于 2015-12-20 22:13
建议楼主贴出代码来看看

找到原因了   是因为顶层代码位数定义错了
此帖出自FPGA/CPLD论坛
 
 
 
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