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JasonnLee

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一粒金砂（中级）
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发表于2015-1-27 11:49 只看该作者
 

CPLD与DSP管脚连接问题 [复制链接]


如图CPLD的管脚TEA6，TEA7，TEA8，TEA9是与DSP的地址线连接的，如果用Quartus编程
OUT0<=TEA6,OUT1<=TEA7,OUT2<=TEA8,OUT3<=TEA9,
那是不是OUT0，OUT1，OUT2，OUT3管脚就相当于DSP的地址管脚了？
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chenzhufly
是的，数据线是双向的  详情 回复 发表于 2015-1-27 14:50
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chenzhufly

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沙发
发表于2015-1-27 12:30 只看该作者
 
对系统理解的有些问题

对于DSP来说，地址线一定是输出的，所以cpld不能对地址线赋值
此帖出自FPGA/CPLD论坛

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JasonnLee
那数据线就可以吧  详情 回复 发表于 2015-1-27 14:27
个人签名生活就是油盐酱醋再加一点糖，快活就是一天到晚乐呵呵的忙
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做一个简单的人，踏实而务实，不沉溺幻想，不庸人自扰
 
 
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JasonnLee

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一粒金砂（中级）
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 楼主| 发表于2015-1-27 14:27 只看该作者
 
chenzhufly 发表于 2015-1-27 12:30
对系统理解的有些问题

对于DSP来说，地址线一定是输出的，所以cpld不能对地址线赋值



那数据线就可以吧
此帖出自FPGA/CPLD论坛
 
 
 
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chenzhufly

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4楼
发表于2015-1-27 14:50 只看该作者
 
是的，数据线是双向的
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JasonnLee
再问下，cpld一边跟DSP的8根数据线相连，一边有外接的输入管脚，如果cpld输入管脚接的是A/D的数字输出，可以直接用DSP编程读取么，还是说必须通过FIFO缓存下才能读取A/D数据？不知道你做过没  详情 回复 发表于 2015-1-27 23:20
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JasonnLee

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一粒金砂（中级）
5楼
 楼主| 发表于2015-1-27 23:20 只看该作者
 
chenzhufly 发表于 2015-1-27 14:50
是的，数据线是双向的


再问下，cpld一边跟DSP的8根数据线相连，一边有外接的输入管脚，如果cpld输入管脚接的是A/D的数字输出，可以直接用DSP编程读取么，还是说必须通过FIFO缓存下才能读取A/D数据？不知道你做过没
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