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发表于2014-11-25 20:46
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verilog 例程代码里面,隐含锁存器是指编写的代码有问题,产生了锁存器吗?
[复制链接]
如下的例程
【例 5.14】隐含锁存器举例
module buried_ff(c,b,a);
output c;
input b,a;
reg c;
always @(a or b)
begin
if((b==1)&&(a==1)) c=a&b;
end
endmodule
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fxyc87
当然某些情况需要保持,这时就可以用隐含锁存器
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发表于 2014-11-26 08:43
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沙发
发表于2014-11-26 08:43
只看该作者
verilog写代码时用if语句时要注意,比如if (a=1) c=2这个语句就包含了一个隐藏的锁存器,当a=1时C=2,当A不等于1时A就保持现有的值
正确的写法是 if(a=1) c=2 else c=0
if时不要忘了else
switch时不要忘了default语句,
总之写判断时任何情况都要包含进去,
这是我的一点理解,
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发表于2014-11-26 08:43
只看该作者
当然某些情况需要保持,这时就可以用隐含锁存器
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