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关于FPGA时钟管脚 [复制链接]


我电路图中这样的连接正确吗? 时钟ECKDB连n还是p有讲究吗?多谢多谢

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建议看喂鸡百科: http://zh.wikipedia.org/wiki/%E5%B7%AE%E5%88%86%E4%BF%A1%E5%8F%B7   详情 回复 发表于 2014-6-23 22:42
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若用的是差动时钟,需要接上一对p-n,单端信号的话就无所谓。
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我也应该是单端信号吧,差动时钟啥意思啊?  详情 回复 发表于 2014-6-23 15:12
 
 

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仙猫 发表于 2014-6-23 11:49
若用的是差动时钟,需要接上一对p-n,单端信号的话就无所谓。

我也应该是单端信号吧,差动时钟啥意思啊?
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建议看喂鸡百科: http://zh.wikipedia.org/wiki/%E5%B7%AE%E5%88%86%E4%BF%A1%E5%8F%B7  详情 回复 发表于 2014-6-23 22:42
 
 
 

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裸片初长成(初级)

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3008202060 发表于 2014-6-23 15:12
我也应该是单端信号吧,差动时钟啥意思啊?


建议看喂鸡百科:
http://zh.wikipedia.org/wiki/%E5%B7%AE%E5%88%86%E4%BF%A1%E5%8F%B7
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谢谢  详情 回复 发表于 2014-6-24 09:59
 
 
 

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仙猫 发表于 2014-6-23 22:42
建议看喂鸡百科:
http://zh.wikipedia.org/wiki/%E5%B7%AE%E5%88%86%E4%BF%A1%E5%8F%B7

谢谢
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