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一粒金砂(初级)

楼主
 

求助,cpld烧写后校验错误 [复制链接]

cpld烧写后校验错误的问题有没有人碰到过

我用的是lattice的LC4032V,每次下载后都提示校验不对,
把烧进去的jed文件读出来,发现确实跟烧写的文件不一样

每一行的最后一个1变为了0
不知道怎么回事,
实在不行就换片子了
此帖出自FPGA/CPLD论坛
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