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zhenpeng25

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TA的资源

一粒金砂（中级）
楼主
发表于2013-11-25 16:56 只看该作者
 

FFT的IP核仿真问题 [复制链接]

最近做一个FFT仿真的，纠结了好久了，仿真就是不对，第一帧数据结束之后会出现一个source_eop拉高，导致source_error为10，以后的一帧数据进去之后sink_ready不拉低，也出现了source_eop，导致了两帧数据才会出一帧的FFT数据，求大神指教。
FFT仿真, IP核

QQ截图20131125164934.png (11.27 KB, 下载次数: 2)

第二帧数据

第二帧数据

QQ截图20131125164708.png (15.36 KB, 下载次数: 1)

第一帧数据

第一帧数据
此帖出自FPGA/CPLD论坛

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Seven_ZGY
亲，我也在做，，还是不行，，能共享一下你的工程吗，  详情 回复 发表于 2016-2-26 20:43
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kdy

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五彩晶圆（初级）
沙发
发表于2013-11-25 19:26 只看该作者
 
是不是逆位序时间没算
此帖出自FPGA/CPLD论坛
个人签名Net：Wxeda.taobao.com
QQ：1035868547
Blog：https://home.eeworld.com.cn/space-uid-390804.html
 
 
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astwyg

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纯净的硅（高级）
板凳
发表于2013-11-26 20:37 只看该作者
 
还没用FPGA做过FFT ,求共享工程
此帖出自FPGA/CPLD论坛
 
 
 
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枫叶知秋

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一粒金砂（初级）
4楼
发表于2014-1-14 17:25 只看该作者
 
可能是你的核没配置正确，发个截图看看。。
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geek1044233591

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一粒金砂（中级）
5楼
发表于2015-7-10 08:29 只看该作者
 
我在仿真的时候，输出一直未高阻，开始感觉是时序没对齐，后来纠正后，还是这样，不知道楼主是否遇到这样的情况
此帖出自FPGA/CPLD论坛
 
 
 
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minjiao

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一粒金砂（初级）
6楼
发表于2015-10-21 19:44 只看该作者
 
geek1044233591 发表于 2015-7-10 08:29
我在仿真的时候，输出一直未高阻，开始感觉是时序没对齐，后来纠正后，还是这样，不知道楼主是否遇到这样的 ...

请问你仿真出结果了吗？
此帖出自FPGA/CPLD论坛

点评

geek1044233591
你是什么问题  详情 回复 发表于 2015-11-27 12:59
 
 
 
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geek1044233591

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一粒金砂（中级）
7楼
发表于2015-11-27 12:59 只看该作者
 
minjiao 发表于 2015-10-21 19:44
请问你仿真出结果了吗？

你是什么问题
此帖出自FPGA/CPLD论坛
 
 
 
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Seven_ZGY

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一粒金砂（中级）
8楼
发表于2016-2-26 20:43 只看该作者
 
亲，我也在做，，还是不行，，能共享一下你的工程吗，
此帖出自FPGA/CPLD论坛
 
 
 
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