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一粒金砂（初级）

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发表于2013-4-27 09:48 只看该作者

ALTERA的DDR2 ip的定制问题（local_init_done） [复制链接]

我用的是CYCLONEIII的芯片，定制DDR2 IP核，之后直接用SINALTAP进行信号抓取，发现无法读写的原因是local_init_done 一直为低，就像XILINX里的phy_init_done信号一样的，要等该信号为高才能对芯片读写，但不知为什么该信号就一直为低，请哪位用过的赐教，说一下接口信号的注意点，谢谢！
（个人还是觉得XILINX的比ALTERA的要好的多，无论是文档编写，还是内部IP核。）

local_init_done, ddr2, FPGA

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