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发表于2012-11-2 10:12 只看该作者

VHDL语言语法的思路。 [复制链接]

小弟是新手，想请教大家一个问题。
我想用VHDL语言在一个时钟周期内，一个IO口输出8位数据，该如何编写呢？有什么思路？

你这个一个时钟周期是多长，是FPGA的系统时钟周期吗啊？如果是，那是无能为力的详情回复发表于 2012-11-3 17:04

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6892 帖子	0 TA的资源

发表于2012-11-3 17:04 只看该作者

你这个一个时钟周期是多长，是FPGA的系统时钟周期吗啊？

如果是，那是无能为力的

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