电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › 生成语句

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1 帖子	0 TA的资源

一粒金砂（初级）

楼主

发表于2012-9-30 10:36 只看该作者

生成语句 [复制链接]

夏老师，我刚刚学习Verilog一个多月，对生成语句理解的不是很清楚，能给我讲一下生成语句吗？谢谢夏老师！

学习, 老师

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许昊

我也是初学者，在网上搜了一个感觉比较好的关于这方面的文献，可以参考一下：http://wenku.baidu.com/link?url= ... _20CX4GU4KYF0PF6x-q。但是看完后还是有点疑惑：不知道它和循环语句有什么区别。详情回复发表于 2014-2-13 10:12

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eeleader

6892 帖子	0 TA的资源

五彩晶圆（高级）

沙发

发表于2012-10-13 18:21 只看该作者

对生成语句理解是啥东西？

此帖出自FPGA/CPLD论坛

个人签名一个为理想不懈前进的人，一个永不言败人！
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许昊

22 帖子	0 TA的资源

一粒金砂（中级）

板凳

发表于2014-2-13 10:12 只看该作者

我也是初学者，在网上搜了一个感觉比较好的关于这方面的文献，可以参考一下：http://wenku.baidu.com/link?url= ... _20CX4GU4KYF0PF6x-q。但是看完后还是有点疑惑：不知道它和循环语句有什么区别。

此帖出自FPGA/CPLD论坛

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