电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › 综合时选错了速度等级有无影响？

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一粒金砂（初级）

楼主

发表于2012-6-3 15:07 只看该作者

综合时选错了速度等级有无影响？ [复制链接]

最近做一个项目，用的是Actel的ProASIC3系列，A3P250，代码综合的时候将速度等级选成了-2级，实际芯片是Std级，最后生成烧写文件下载进去以后发现功能都还正常。

后来我对比了将速度等级设为不同的级别，综合后的网表差异还是比较大的

如果将速度等级选择错误，烧写进去后会有什么样的隐患吗？

文件下载, 影响

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eeleader

最多影响布局布线，不同速度等级的延迟时间不同。详情回复发表于 2012-6-28 19:41

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chunyang

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版主

沙发

发表于2012-6-3 22:06 只看该作者

只要信号频率不超过器件的极限即可。

此帖出自FPGA/CPLD论坛

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eeleader

6892 帖子	0 TA的资源

五彩晶圆（高级）

板凳

发表于2012-6-28 19:41 只看该作者

最多影响布局布线，不同速度等级的延迟时间不同。

此帖出自FPGA/CPLD论坛

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