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zhaoxin19851985

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一粒金砂（初级）
楼主
发表于2012-5-30 09:07 只看该作者
 

异步fifo的verilog设计 [复制链接]

fifo的设计难点是产生可靠的FIFO读/写指针和生成FIFO空/满状态标志
设计
此帖出自FPGA/CPLD论坛

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liuhanjunfly
very good  详情 回复 发表于 2012-7-14 21:34
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zhaoxin19851985

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一粒金砂（初级）
沙发
 楼主| 发表于2012-5-30 09:09 只看该作者
 

刚才忘记传附件了

 

异步FIFO设计.zip

2.91 KB, 下载次数: 33

售价: 1 分芯积分  [记录]

此帖出自FPGA/CPLD论坛
 
 
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eeleader

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五彩晶圆（高级）
板凳
发表于2012-5-31 15:35 只看该作者
 

收下看看！谢谢

此帖出自FPGA/CPLD论坛
个人签名一个为理想不懈前进的人，一个永不言败人！
http://shop57496282.taobao.com/
欢迎光临网上店铺！
 
 
 
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liuhanjunfly

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一粒金砂（初级）
4楼
发表于2012-7-14 21:34 只看该作者
 
very good
此帖出自FPGA/CPLD论坛
 
 
 
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