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mr.king

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一粒金砂（高级）
楼主
发表于2012-3-25 22:24 只看该作者
 

发FPGA+SDRAM的高深度逻辑分析仪设计思路，原创的 [复制链接]

供参考。

[ 本帖最后由 mr.king 于 2012-3-25 22:31 编辑 ]
分析仪, 设计

基于FPGA和SDRAM设计低成本高深度8路虚拟逻辑分析仪控制器1.doc

117.5 KB, 下载次数: 522
此帖出自FPGA/CPLD论坛

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microfly
楼主给力，谢谢分享  详情 回复 发表于 2012-9-20 10:13

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cztct01@126.com
学习一下，谢谢楼主  详情 回复 发表于 2012-7-7 12:57
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eeleader

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五彩晶圆（高级）
沙发
发表于2012-3-26 13:06 只看该作者
 

顶顶顶，好东西，收下！

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个人签名一个为理想不懈前进的人，一个永不言败人！
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wall_e

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一粒金砂（高级）
板凳
发表于2012-3-31 19:56 只看该作者
 
我做了一个不用sdram的用片上的ram，只有512bits深度。楼主的给力啊。
此帖出自FPGA/CPLD论坛
个人签名努力就有不清不楚的收获。
 
 
 
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siposi

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一粒金砂（中级）
4楼
发表于2012-3-31 23:03 只看该作者
 
支持一下
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lxlong_006

37

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一粒金砂（初级）
5楼
发表于2012-4-6 11:38 只看该作者
 

回复 楼主 mr.king 的帖子

楼主很厉害啊，多多向你学习了。
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能圈就圈

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一粒金砂（高级）
6楼
发表于2012-5-30 08:55 只看该作者
 
收下,再看.
此帖出自FPGA/CPLD论坛
个人签名能力越大,责任越大;知道越多,未知更多
 
 
 
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honestapple

87

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一粒金砂（中级）
7楼
发表于2012-5-30 09:00 只看该作者
 
强悍。收下研究研究。
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Arthur339432

1

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一粒金砂（中级）
8楼
发表于2012-5-30 09:05 只看该作者
 
DIY   虽然我没用过赛灵思的工具 这个既然是虚拟的逻辑分析仪  那就应该占用资源才是吧
此帖出自FPGA/CPLD论坛
 
 
 
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mr.king

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一粒金砂（高级）
9楼
 楼主| 发表于2012-5-30 09:21 只看该作者
 

这里虚拟的意思

是通过PC机显示波形,不用你开发调试FPGA的资源
此帖出自FPGA/CPLD论坛
 
 
 
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eeleader

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五彩晶圆（高级）
10楼
发表于2012-5-31 15:30 只看该作者
 

楼主厉害！

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mahn168

16

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一粒金砂（中级）
11楼
发表于2012-6-5 22:49 只看该作者
 
收下看看
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eeleader

6892

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五彩晶圆（高级）
12楼
发表于2012-6-28 19:40 只看该作者
 
hao
此帖出自FPGA/CPLD论坛
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wanglei0307

53

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一粒金砂（中级）
13楼
发表于2012-7-6 21:31 只看该作者
 
下来研习一番。。谢谢。
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cztct01@126.com

4

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一粒金砂（初级）
14楼
发表于2012-7-7 12:57 只看该作者
 

回复 楼主 mr.king 的帖子

学习一下，谢谢楼主
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kobe1941

449

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纯净的硅（高级）
15楼
发表于2012-7-7 18:31 只看该作者
 
这个必须顶，先拿走了以后再看，
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domon

5

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一粒金砂（初级）
16楼
发表于2012-8-17 21:18 只看该作者
 
下来 学习学习
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行胜于言

12

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一粒金砂（初级）
17楼
发表于2012-8-20 22:47 只看该作者
 

看看

看看
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kilter

11

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一粒金砂（初级）
18楼
发表于2012-8-24 14:11 只看该作者
 
资料下来看看，谢过楼主了
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awarenessxie

705

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纯净的硅（中级）
19楼
发表于2012-9-1 20:09 只看该作者
 
拿走了。楼主，3Q
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whf715

15

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一粒金砂（初级）
20楼
发表于2012-9-7 10:14 只看该作者
 
看看那了啊，不错的资料
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