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发表于2012-2-19 10:11 只看该作者

【设计工具】verilog 不可综合语句总结汇总 [复制链接]

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好贴好贴！详情回复发表于 2012-2-20 15:52

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发表于2012-2-20 15:52 只看该作者

好贴好贴！

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verilog 不可综合语句总结 ...
[attach]465174[/attach]
verilog 不可综合语句
转自ednchina（1）所有综合工具都支持的结构：always，assign，begin，end，case，wire，tri，aupply0，supply1，reg，integer，default，for，function，and，nand，or，nor，xor，xnor，buf，not，bufif0，bufif1，notif0，notif1，if，inout，input，insta ...
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