电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › 【设计工具】Verilog数字系统设计示例

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一粒金砂（高级）

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发表于2012-2-19 10:03 只看该作者

【设计工具】Verilog数字系统设计示例 [复制链接]

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Verilog数字系统设计示例.rar

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eeleader

好贴好贴！详情回复发表于 2012-2-20 15:54

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eeleader

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五彩晶圆（高级）

沙发

发表于2012-2-20 15:54 只看该作者

好贴好贴！

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