电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › 步进频率信号

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一粒金砂（中级）

楼主

发表于2011-12-15 11:14 只看该作者

步进频率信号 [复制链接]

想用FPGA产生步进频率的信号，使用verilog 编写DDS，里面涉及到每一个频率持续的时间控制，还有频率的步进量控制，搞不清如何使用循环语句进行描述，求大家给点意见

频率, 信号, 如何

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恩，比如说我想每个频率持续100个单位时间，然后频率就要改变，这个应该怎么办

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jjkwz

2734 帖子	0 TA的资源

裸片初长成（初级）

4楼

发表于2011-12-18 16:44 只看该作者

用一个cnt计数器，然后不断的计数，累加计数就好了，这个还是比较简单地说，楼主要好好学习啊！

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个人签名我爱电子！

whalechao

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一粒金砂（中级）

5楼

楼主| 发表于2011-12-29 15:07 只看该作者

回复 4楼 jjkwz 的帖子

恩，谢谢啊，我是需要好好学习呢，对很多东西都还不了解

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