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jackwanghpss

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一粒金砂（中级）
楼主
发表于2011-11-9 23:00 只看该作者
 

有没有做过1G采样系统的PCB [复制链接]

有没有做过1G采样系统的PCB啊？不知道现在做的这样高频的人多不多？技术怎么样啊？
系统
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造化为工
肯定是找专用时钟芯片了，有可以产生1G的时钟芯片，也有产生多路固定相移的时钟芯片，从你AD后面的角度考虑（应该是用FPGA吧），用多片低频的AD并联可能更好，起码我想同步还有吞吐量方面会更好，我也没做过1G的采样，如果是我要做，我可能用4片250MHz的AD并联，哈哈  详情 回复 发表于 2011-11-15 18:14
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PCB设计论坛  PCB设计  PCB Layout
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造化为工

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一粒金砂（中级）
沙发
发表于2011-11-10 08:59 只看该作者
 
楼主用什么AD，或者多个AD并联，采用时钟管理器件给时钟？
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djdhn

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一粒金砂（中级）
板凳
发表于2011-11-10 09:20 只看该作者
 
多吧。。楼主自己想学这方面的吗。
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个人签名[url=http://www.51great.org/]嵌入式培训[/url
 
 
 
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jackwanghpss

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一粒金砂（中级）
4楼
 楼主| 发表于2011-11-10 22:11 只看该作者
 

回复 沙发 造化为工 的帖子

可能会用一个AD芯片，如max104,max108之类的。考虑到时钟产生的难度，也可能会选用多个并联的AD,但是这样很麻烦啊！有人说时钟很难设计，不知道有没有做过的人，帮忙分析一下：用一个1GHz的时钟和一个AD好，还是用500MHz的时钟和两个AD好啊？
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jackwanghpss

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一粒金砂（中级）
5楼
 楼主| 发表于2011-11-10 22:15 只看该作者
 

回复 板凳 djdhn 的帖子

可又介绍一些这方面的资料吗？又前做高速的设计不是很多，现在有项目要用到。谢谢！
此帖出自PCB设计论坛
 
 
 
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jackwanghpss

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一粒金砂（中级）
6楼
 楼主| 发表于2011-11-12 23:11 只看该作者
 
自顶一下
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造化为工

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一粒金砂（中级）
7楼
发表于2011-11-15 18:14 只看该作者
 

回复 4楼 jackwanghpss 的帖子

肯定是找专用时钟芯片了，有可以产生1G的时钟芯片，也有产生多路固定相移的时钟芯片，从你AD后面的角度考虑（应该是用FPGA吧），用多片低频的AD并联可能更好，起码我想同步还有吞吐量方面会更好，我也没做过1G的采样，如果是我要做，我可能用4片250MHz的AD并联，哈哈
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