电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › 仿真时如何能看到ram中的数据呢？

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一粒金砂（高级）

楼主

发表于2010-11-19 15:15 只看该作者

仿真时如何能看到ram中的数据呢？ [复制链接]

仿真时如何能导出ram中的数据呢？是在testbench中有特定的语句吗？（verilog）还是modelsim中有这样的功能呢？
请教各位高人和大神！

数据, 如何

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eeleader

我一般这样处理的，写一个控制模块，去读RAM中的数据，然后把数据输出到总线上去观看，通过总线观测到数据就OK乐详情回复发表于 2010-11-24 09:21

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eeleader

6892 帖子	0 TA的资源

五彩晶圆（高级）

沙发

发表于2010-11-24 09:21 只看该作者

我一般这样处理的，写一个控制模块，去读RAM中的数据，然后把数据输出到总线上去观看，通过总线观测到数据就OK乐

此帖出自FPGA/CPLD论坛

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