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Gerryi

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一粒金砂（中级）
楼主
发表于2020-6-10 23:30 只看该作者
 

FPGA实验中的问题 [复制链接]

本帖最后由 Gerryi 于 2020-6-10 23:33 编辑

 

我们做的实验以及拓展，实验三做成功了，但是它的拓展出现了问题，

这个是已经把Y改成Y7~0的一种方案，还是不可行，希望有大神可以来帮个忙看一下，跪谢

EE_FPGA, FPGA

TIM图片20200610233203.png (58.49 KB, 下载次数: 0)

TIM图片20200610233203.png

TIM图片20200610233209.png (21.45 KB, 下载次数: 0)

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TIM图片20200610233214.png (18.49 KB, 下载次数: 0)

TIM图片20200610233214.png
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okhxyyo
还是不行是指什么情况呢？？？有什么现象   详情 回复 发表于 2020-6-11 15:15
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okhxyyo

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沙发
发表于2020-6-11 15:15 只看该作者
 

还是不行是指什么情况呢？？？有什么现象

此帖出自FPGA/CPLD论坛
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Gerryi
把Y取反后用LED灯一直不亮    详情 回复 发表于 2020-6-13 11:07
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Gerryi

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一粒金砂（中级）
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 楼主| 发表于2020-6-13 11:07 只看该作者
 
okhxyyo 发表于 2020-6-11 15:15 还是不行是指什么情况呢？？？有什么现象

把Y取反后用LED灯一直不亮

 

此帖出自FPGA/CPLD论坛
 
 
 
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