电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › 约束的问题

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一粒金砂（初级）

楼主

发表于2010-7-22 14:45 只看该作者

约束的问题 [复制链接]

想问问大家：如何设置扇出的约束呢，我没有用第三方工具，用quartus11自带的。

我在想如何将某个寄存器或者说是信号约束在芯片资源的某一个位置呢？

谁能解惑呵呵。谢谢了。

问题, 工具, 寄存器, 第三方, 如何

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仙猫

按“Assignment Edito”图标，对输出脚添加“Current Strength”。俺对Quartus II玩得不熟，摸过就忘了，仅供参考。详情回复发表于 2010-7-22 15:16

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yaxuangela

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一粒金砂（初级）

沙发

楼主| 发表于2010-7-22 14:46 只看该作者

我的timing analyzer 里面为什么没有tsu，和th啊，只有tco，

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仙猫

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裸片初长成（初级）

板凳

发表于2010-7-22 15:16 只看该作者

按“Assignment Edito”图标，对输出脚添加“Current Strength”。
俺对Quartus II玩得不熟，摸过就忘了，仅供参考。

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