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近来在FPGA原厂的网站上，勾起了BSDL这个词的回忆，大学刚开始学习FPGA的时候，考试还出过相关的填空题，所以有点印象，但从此对这个感念没有进行过分析和应用。这次碰上这个词特别有感觉，所以拿出来，看各位朋友是否有相关的经验分享一下。
以下是在网上找到的相关概念：
Boundary-Scan Description Language
BSDL(边界扫描描述语言)文件是使用边界扫描进行电路板级和系统级测试与在系统编程所必需的。 BSDL 文件是描述一个 IC 中的 IEEE 1149.1 或 JTAG 设计电子数据表，这些文件由 IC 供应商提供，作为其设备规格的一部分。
“边界扫描”是一种可测性设计技术，即在电子系统的设计阶段就考虑其测试问题。
BSDL（boundary scan des cription language） 语言硬件描述语言（VHDL）的一个子集，是对边界扫描器件的边界扫描特性的描述，主要用来沟通边界扫描器件厂商、用户与测试工具之间的联系，其应用包括：厂商将BSDL描述作为边界扫描器件的一部分提供给用户；BSDL描述为自动测试图形生成（ATPG）工具测试特定的电路板提供相关信息；在BSDL的支持下生成由IEEE1149.1标准定义的测试逻辑。现在，BSDL语言已经正式成为IEEE1149.1标准文件的附件。BSDL本身不是一种通用的硬件描述语言，但它可与软件工具结合起来用于测试生成、结果分析和故障诊断。每一边界扫描器件都附有特定的BSDL描述文件.
指令捕获（INSTRUCTION_CAPTURE）属性提供了测试TAP完整性的一条途径。TAP完整性测试可以检测时钟TCK和模式选择TMS的输入端连接是否正确，所提供的有关信号是否正常；数据输入TDI和数据输出TDO端的连接是否正确，且输入和输出的功能是否正常；内部的指令寄存器工作是否正常；内部的边界扫描寄存器工作是否正常。TAP完整性测试是进行边界扫描其他任何测试之前建议首先进行的测试操作，以确保边界扫描链能正常工作。
TAP完整性测试的过程如图3所示。在TAP的 Shift-IR状态，指令捕获位图形已加载至指令寄存器的移位寄存器部分，直接从TDO移出数据并与各芯片的Capture位图形比较，若数据一致则TAP完整性测试通过。
芯片ID码是识别芯片的内建器件标识码，通过检测芯片ID码可以识别该芯片，判断芯片装配正确与否，并可进一步判断芯片的型号、生产厂家及版本号与其标识是否相符，辨别芯片的真伪。当TAP进入Test-Logic-Reset状态时，若标志寄存器存在，则被强制接入TDI与TDO之间，寄存器LSB的值为“1”，否则，旁路寄存器被接入TDI与TDO之间，寄存器的值为“0”。所以，在检测芯片标志寄存器的值时，可以由复位状态直接进入移位数据状态，输出TDO的值，并判断其第一位是否为“1”，若是，则此芯片有标准寄存器存在，可继续移出其他31位，并进行判断与显示。检测流程如图4所示。我们在对芯片EPM7128SL84进行ID标识码检测时，用逻辑分析仪采集到的TDO端的输出波形如图5所示，与BSDL描述中的ID码一致，说明器件正确。
我们在开发边界扫描测试软件过程中，设计制作了基于边界扫描机制的试验电路板当作诊断实验对象。其中两块EPM7128SL84芯片间的有16个互连网络，分别是两芯片的4～12管脚之间、33～41管脚之间的互连（除去7脚地线，38脚电源线）。在进行互连测试时，首先要构造一个16×16的测试矩阵，然后将此矩阵的16个列向量分别加载到芯片1的IO4～ IO12，IO33～IO41管脚（除去7脚和38脚），然后执行外部测试指令。由芯片2捕获对应管脚上的信号，形成响应向量，全部16个列向量分别加载捕获完成后，再对响应矩阵进行故障诊断 [3]，如图6所示。在此测试过程中，对芯片1的IO管脚加载的向量数据必须定位到每个管脚对应的三态输出单元，即芯片1的281，278，275，269，263，260， 257，251，179，173，167，164，161，155，149，146单元；而芯片2所捕获的对应管脚上的信号，在执行采样指令之后，都被置入每个管脚对应的输入单元，即芯片2的279，276，273，267， 261，258，255，249，177，171，165，162，159，153，147，144单元。这样，从TDO输出的对应单元的数据就组成了响应矩阵，对响应矩阵按照一定的算法进行分析，便可检测出呆滞、开路与桥接故障。
[ 本帖最后由 fsyicheng 于 2010-6-19 12:24 编辑 ]
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