运放差分衰减电路问题

jesseyuan

运放差分衰减电路问题 [复制链接]

我想用运放做一个电压 衰减的电路，用于测量3~48V直流信号，附件是初步的电路图，但在调试时不能解决工频干拢问题，请问各位大神电路中是否有什么问题，如何改进，谢谢！

maychang

电原理图看不出什么问题。

“调试时不能解决工频干拢问题”
是想说“干扰问题”吧？
干扰问题非常困难。楼主最好先描述清楚电路如何受到干扰，表现出什么现像，曾采取什么措施来解决……

jesseyuan

maychang 发表于 2018-11-22 17:32
电原理图看不出什么问题。

“调试时不能解决工频干拢问题”
是想说“干扰问题”吧？
干扰问题非常困难 ...

电路衰减20倍输出是正常的，但接上线性电源电压时输出端用示波器看有50Hz约10mV 峰值电压。请问是否有好方法滤除共模干拢信号？PCB layout 已用差分输入走线。Layout上看应没有问题。

jesseyuan

jesseyuan 发表于 2018-11-22 17:55
电路衰减20倍输出是正常的，但接上线性电源电压时输出端用示波器看有50Hz约10mV 峰值电压。请问是否有好 ...

对的，是干扰问题，又打错字了

chunyang

必须先确认干扰耦合进来的位置和原因，这个仅靠电路图是不行的。

maychang

jesseyuan 发表于 2018-11-22 17:55
电路衰减20倍输出是正常的，但接上线性电源电压时输出端用示波器看有50Hz约10mV 峰值电压。请问是否有好 ...

需要先确定干扰从何而来才好采取措施。5楼chunyang说“必须先确认干扰耦合进来的位置和原因”是完全正确的。

maychang

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