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五彩晶圆（高级）
楼主
发表于2010-5-2 16:20 只看该作者
 

讨论下latch的time borrowing？ [复制链接]

讨论下latch的time borrowing？

对于time borrowing不是很清楚，高手是否可以讲讲？

另外，latch为什么可以加速设计？
设计
此帖出自FPGA/CPLD论坛

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DSP16
time borrowing是老一辈full custom设计者喜欢的， 但是现在的EDA都没法分析这个，所以现在基本上一般的ASIC design都不会用。 基本的感念就是因为latch是电平触发的，数据只要在半T内通过都可以，所以上一级可以在下一级打开的时间段内继续算，只要在下一级关闭之前算出来就可以了。 但是不能一直借下去  详情 回复 发表于 2010-5-2 16:20
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DSP16

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一粒金砂（初级）
沙发
发表于2010-5-2 16:20 只看该作者
 
time borrowing是老一辈full custom设计者喜欢的，
但是现在的EDA都没法分析这个，所以现在基本上一般的ASIC design都不会用。
基本的感念就是因为latch是电平触发的，数据只要在半T内通过都可以，所以上一级可以在下一级打开的时间段内继续算，只要在下一级关闭之前算出来就可以了。
但是不能一直借下去
此帖出自FPGA/CPLD论坛
 
 
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