电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › 请教M序列发生器的设计

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五彩晶圆（高级）

楼主

发表于2010-4-28 13:48 只看该作者

请教M序列发生器的设计 [复制链接]

最近需要作个M序列发生器，
搜索了很多文档，都是串行产生M序列！
这样就导致每一个比特都需要一个时钟来产生，
如果M序列很长，就将是个灾难，所有的配套电路
都需要重新编写，运行速度也会受到极大影响。

我想请问大家有没有并行产生M序列的方法，
每次最好产生32bit或者64bit等。

发生器, 比特, 影响, 灾难

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skk7611

查表试试详情回复发表于 2016-5-27 10:04

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一粒金砂（初级）

沙发

发表于2010-4-28 14:11 只看该作者

路过，顶起

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CSCL

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纯净的硅（高级）

板凳

发表于2010-4-28 14:12 只看该作者

M序列串行才能正常工作，否则并行可能有问题

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skk7611

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一粒金砂（初级）

4楼

发表于2016-5-27 10:04 只看该作者

查表试试

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